80286

3╚═══════════════════════════════════════╝

Ниже приводится описание сигналов канала ввода-вывода сис-

темной платы. все сигнальные линии ТТЛ- совместимы. адаптеры

ввода-вывода должны рассчитываться максимально на две маломощных

нагрузки ТТЛШ на одну линию.

2┌─────────────────────────────────┐

2│ Сигналы SA0 - SA19 (ввод-вывод) │

2└─────────────────────────────────┘

Адресные разряды 0 - 19 используются для адресации к памяти

и устройствам ввода - вывода внутри системы. эти 20 адресных ли-

ний, вместе с линиями LA17 - LA23 , обеспечивают доступ к 16 Мб

памяти. SA0 - SA19 выводятся в системную шину, когда 'BALE' име-

ет высокий уровень , и защелкивается по заднему фронту 'BALE'.

эти сигналы генерируются микропроцессором или контроллером пдп.

ими могут также управлять другие микропроцессоры или контроллеры

ПДП, находящиеся на канале ввода-вывода.

2┌──────────────────────────────────┐

2│ Сигналы LA17 - LA23 (ввод-вывод) │

2└──────────────────────────────────┘

Эти сигналы (незащелкнутые) используются для адресации к

памяти и устройствам ввода-вывода внутри системы, они обеспечи-

вают доступ к 16 Мб памяти. Эти сигналы истинны, когда 'BALE'

имеет высокий уровень. LA17 - LA23 не защелкиваются во время

циклов микропроцессора и поэтому не сохраняют истинность в тече-

ние всего цикла. Целью этих адресных линий является генерация

сигналов выбора памяти для циклов памяти с одним состоянием ожи-

дания. эти сигналы выбора должны защелкиваться адаптерами ввода

- вывода по заднему фронту 'BALE'. Этими сигналами могут также

управлять другие микропроцессоры или контроллеры ПДП , находящи-

еся на канале ввода-вывода.

2┌────────┐

2│ CLK(O) │

2└────────┘

Это сигнал синхронизации системы с частотой 6 Мгц, он расс-

читан на цикл микропроцессора длительностью 167 Нс. Рабочий цикл

составляет 50% этого сигнала. Сигнал должен использоваться толь-

ко для целей синхронизации. он не предназначен для тех случаев,

когда требуется постоянная частота.

2┌──────────────┐

2│ RESET DRV(O) │

2└──────────────┘

'RESET DRIVE' используется для очистки или инициализации

логических схем системы при включении питания или при падении

напряжения на линии. этот сигнал активен при высоком уровне.

.

- 10 -

2┌────────────────────────┐

2│ SD0 - SD15 (ввод-вывод)│

2└────────────────────────┘

Эти сигналы обеспечивают установку разрядов 0 - 15 для мик-

ропроцессора, памяти и устройств ввода-вывода. D0 является млад-

шим разрядом , а D15 - старшим. Все 8-разрядные устройства на

канале ввода-вывода должны использовать для связи с микропроцес-

сором разряды D0 - D7. 16-разрядные устройства используют разря-

ды D0 - D15. для поддержки 8-разрядных устройств данные с линий

D8 - D15 будут выводиться на линии D0 - D7 во время циклов

8-разрядных передач на эти устройства; при передаче данных из

16-разрядного микропроцессора на 8-разрядное устройство эти дан-

ные преобразуются в 8-разрядные.

2┌──────────────────────────┐

2│ BALE(O) (с буферизацией) │

2└──────────────────────────┘

Сигнал 'BUS ADDRESS LATCH ENABLE' генерируется контроллером

шины 82288 и используется на системной плате для защелкивания

истинных адресов и сигналов выбора памяти, поступающих из мик-

ропроцессора. Канал ввода - вывода рассматривает его как индика-

тор истинного адреса микропроцессора или пдп (когда используется

'AEN'). Адреса микропроцессора SA0 - SA19 защелкиваются по зад-

нему фронту 'BALE'. Во время циклов ПДП на 'BALE' устанавливает-

ся высокий уровень.

2┌────────────────┐

2│ -I/O CH CK (I) │

2└────────────────┘

Сигнал '-I/O CHANNEL CHECK' обеспечивает системную плату

информацией об ошибках четности в памяти или устройствах на ка-

нале ввода - вывода. Когда сигнал активен, он индицирует неуст-

ранимую системную ошибку.

2┌────────────────┐

2│ I/O CH RDY (I) │

2└────────────────┘

Сигнал 'I/O CHANNEL READY' устанавливается памятью или уст-

ройством ввода-вывода на низкий уровень ( нет готовности), чтобы

удлинить циклы ввода-вывода или памяти. Любое устройство с низ-

ким быстродействием, использующее эту линию, должно установить

на ней низкий уровень, как только обнаружит свой истинный адрес

и команду чтения или записи. Машинные циклы продлеваются на це-

лое число периодов синхронизации (167 Нс). Этот сигнал должен

сохранять низкий уровень не менее 2,5 Мкс.

2┌───────────────────────────────────────────┐

2│ IRQ3 - IRQ7, IRQ9 - IRQ12 и IRQ14 - IRQ15 │

2└───────────────────────────────────────────┘

Сигналы 'INTERRUPT REQUEST' 3 - 7, 9 - 12, 14 и 15 исполь-

зуются для сообщения микропроцессору о том , что устройство вво-

да-вывода требует обслуживания. Запросы на прерывание имеют при-

оритетную структуру: IRQ9 - IRQ12 , 14 и 15 имеют высший приори-

тет ( IRQ9 - наивысший), а IRQ3 - IRQ7 имеют низший приоритет (

IRQ7 - наинизший). Запрос на прерывание генерируется , когда

уровень на линии IRQ изменяется с низкого на высокий. Высокий

уровень на линии должен сохраняться до тех пор , пока микропро-

цессор не подтвердит запрос на прерывание ( подпрограмма обслу-

- 11 -

живания прерываний ). IRQ13 используется на системной плате , но

не доступен на канале ввода-вывода. IRQ8 используется для часов

реального времени.

2┌─────